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W2303EP Verilog-A 组件

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概述和特性
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HIGHLIGHTS

W2303EP Verilog-A 组件包括：

支持在 ADS 中使用行业标准的 Verilog-A 语言开发模型，其运行时间速度和收敛性与内置 ADS 模型不相上下
Verilog-A 模型可在 ADS 时域、频域和包络域系统和电路仿真器中进行仿真和优化，您可以访问所有功能强大的内部收敛算法
与使用 C 语言建立的模型相比，代码行数仅为十分之一
一次开发的模型可在所有 Verilog A 兼容仿真器中使用，非常便携，可通过设计套件进行分发
Verilog-A 模型参数可以从 Keysight IC-CAP 器件建模环境的测量结果中提取

Verilog-A 组件是 Keysight EEsof EDA 提供的一个模拟特性建模和仿真环境。Keysight EEsof EDA 是高频混合信号电子设计自动化（EDA）领域的技术和创新先锋。Verilog-A 组件无缝整合在先进设计系统（ADS）中。ADS 是唯一能够在高频和高速应用中实现集成电路、封装和电路板协同设计的设计仿真平台。ADS 将系统、电路和完全三维电磁仿真与是德科技的测试仪器无缝衔接，让您能够不断做出成功的设计并一次测试合格。

Verilog-A 组件支持您使用行业标准的 Verilog-A 语言在 ADS 中进行模拟特性建模，应用范围覆盖从晶体管到 MEM 的广阔领域。Verilog-A 模型不仅编译速度快，还可在 ADS 时域、频域或包络域系统以及电路仿真器中进行仿真和优化。用户自定义的模型（使用标准的 Verilog-A 方程结构）在 ADS 中经过了智能编译，能够利用专为内置 ADS 模型开发的快速、稳定的收敛算法，因此您无需了解特定仿真器在收敛时使用何种特定形式的特性方程。该组件为新建的和内置的 ADS 模型提供了一个综合资源库，内含极具价值的 Verilog-A 源代码，使您可以快速开发新模型或高效定制基础模型方程。定制的 Verilog-A 模型可以包含从是德科技强大的集成电路表征和分析程序（IC-CAP）的测量结果中提取的参数。IC-CAP 是一种参数提取和器件建模软件环境，它还能够控制仪器和探头台。

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